FS32K146HFT0VLQT NXP
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FS32K146HFT0VLQT NXP
• Características de funcionamiento – Rango de voltaje: 2.7 V a 5.5 V – Rango de temperatura ambiente: -40 °C a 105 °C para el modo HSRUN, -40 °C a 150 °C para el modo RUN • Núcleo Arm Cortex-M4F/M0+, CPU de 32 bits: admite una frecuencia de hasta 112 MHz (modo HSRUN) con MIPS de 1,25 Dhrystone por MHz – Arm™ Core basado en la arquitectura Armv7 y Thumb-2® ISA – Procesador de señal digital integrado (DSP) – Controlador de interrupciones vectorial anidado configurable (NVIC) – Punto flotante de precisión única Unidad (FPU) • Interfaces de reloj: oscilador externo rápido (SOSC) de 4 - 40 MHz con reloj de entrada cuadrado externo de hasta 50 MHz DC en modo de reloj externo: oscilador RC interno rápido de 48 MHz (FIRC): oscilador RC interno lento de 8 MHz (SIRC): oscilador de baja potencia (LPO) de 128 kHz: hasta 112 MHz (HSRUN) Bucle de bloqueo en fase del sistema (SPLL): TCLK de hasta 20 MHz y SWD_CLK de 25 MHz: reloj externo de contador en tiempo real de 32 kHz (RTC_CLKIN) • Alimentación administración: núcleo Arm Cortex-M4F / M0+ de baja potencia con excelente eficiencia energética - Controlador de administración de energía (PMC) con múltiples modos de energía: HSRUN, RUN, STOP, VLPR y VLPS. Nota: Las escrituras/borradas CSEc (Seguridad) o EEPROM activarán indicadores de error en modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrado CSEc (Seguridad) o EEPROM. – Activación del reloj y funcionamiento de baja potencia soportado en periféricos específicos. • Memoria e interfaces de memoria: hasta 2 MB de memoria flash de programa con ECC: FlexNVM de 64 KB para memoria flash de datos con emulación ECC y EEPROM. Nota: Las escrituras/borrados CSEc (Seguridad) o EEPROM activarán indicadores de error en modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrado CSEc (Seguridad) o EEPROM. – SRAM de hasta 256 KB con ECC – Hasta 4 KB de FlexRAM para usar como emulación SRAM o EEPROM – Hasta 4 KB de caché de código para minimizar el impacto en el rendimiento de las latencias de acceso a la memoria – QuadSPI con soporte HyperBus™ • Analógico de señal mixta: hasta dos convertidores de analógico a digital (ADC) de 12 bits con hasta 32 entradas analógicas de canal por módulo – Un comparador analógico (CMP) con convertidor digital a analógico (DAC) interno de 8 bits • Funcionalidad de depuración – Serial Wire JTAG Combinación de puerto de depuración (SWJ-DP): punto de seguimiento y rastreo de depuración (DWT) – macrocelda de seguimiento de instrumentación (ITM) – unidad de interfaz de puerto de prueba (TPIU) – unidad de parche y punto de interrupción de Flash (FPB) • Interfaz hombre-máquina (HMI): hasta 156 pines GPIO con funcionalidad de interrupción – Interrupción no enmascarable (NMI)
• Interfaces de comunicaciones: hasta tres módulos de receptor/transmisor asíncrono universal de baja potencia (LPUART/LIN) con soporte DMA y baja disponibilidad de energía: hasta tres módulos de interfaz periférica serie (LPSPI) de baja potencia con soporte DMA y baja disponibilidad de energía – Hasta dos módulos de circuito interintegrado de baja potencia (LPI2C) con soporte DMA y baja disponibilidad de energía – Hasta tres módulos FlexCAN (con soporte CAN-FD opcional) – Módulo FlexIO para emulación de protocolos de comunicación y periféricos (UART, I2C, SPI, I2S, LIN, PWM, etc). – Hasta un Ethernet de 10/100Mbps compatible con IEEE1588 y dos módulos de interfaz de audio síncrono (SAI). • Seguridad y protección: el motor de servicios criptográficos (CSEc) implementa un conjunto completo de funciones criptográficas como se describe en la especificación funcional SHE (Secure Hardware Extension). Nota: Las escrituras/borrados CSEc (Seguridad) o EEPROM activarán indicadores de error en modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrado CSEc (Seguridad) o EEPROM. – Número de identificación única (ID) de 128 bits – Código de corrección de errores (ECC) en memorias flash y SRAM – Unidad de protección de memoria del sistema (MPU del sistema) – Módulo de comprobación de redundancia cíclica (CRC) – Vigilante interno (WDOG) – Módulo de monitor de vigilancia externo (EWM) • Temporización y control: hasta ocho módulos FlexTimers (FTM) independientes de 16 bits, que ofrecen hasta 64 canales estándar (IC/OC/PWM) – Un temporizador de baja potencia (LPTMR) de 16 bits con control de reactivación flexible – Dos bloques de retardo programables (PDB) con Sistema de disparo: un temporizador de interrupción de baja potencia (LPIT) de 32 bits con 4 canales: contador en tiempo real (RTC) de 32 bits • Paquete: QFN de 32 pines, LQFP de 48 pines, LQFP de 64 pines, LQFP de 100 pines, MAPBGA de 100 pines, LQFP de 144 pines, LQFP de 176 pines • DMA de 16 canales con hasta 63 fuentes de solicitud utilizando DMAMUX
• Características de funcionamiento – Rango de voltaje: 2.7 V a 5.5 V – Rango de temperatura ambiente: -40 °C a 105 °C para el modo HSRUN, -40 °C a 150 °C para el modo RUN • Núcleo Arm Cortex-M4F/M0+, CPU de 32 bits: admite una frecuencia de hasta 112 MHz (modo HSRUN) con MIPS de 1,25 Dhrystone por MHz – Arm™ Core basado en la arquitectura Armv7 y Thumb-2® ISA – Procesador de señal digital integrado (DSP) – Controlador de interrupciones vectorial anidado configurable (NVIC) – Punto flotante de precisión única Unidad (FPU) • Interfaces de reloj: oscilador externo rápido (SOSC) de 4 - 40 MHz con reloj de entrada cuadrado externo de hasta 50 MHz DC en modo de reloj externo: oscilador RC interno rápido de 48 MHz (FIRC): oscilador RC interno lento de 8 MHz (SIRC): oscilador de baja potencia (LPO) de 128 kHz: hasta 112 MHz (HSRUN) Bucle de bloqueo en fase del sistema (SPLL): TCLK de hasta 20 MHz y SWD_CLK de 25 MHz: reloj externo de contador en tiempo real de 32 kHz (RTC_CLKIN) • Alimentación administración: núcleo Arm Cortex-M4F / M0+ de baja potencia con excelente eficiencia energética - Controlador de administración de energía (PMC) con múltiples modos de energía: HSRUN, RUN, STOP, VLPR y VLPS. Nota: Las escrituras/borradas CSEc (Seguridad) o EEPROM activarán indicadores de error en modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrado CSEc (Seguridad) o EEPROM. – Activación del reloj y funcionamiento de baja potencia soportado en periféricos específicos. • Memoria e interfaces de memoria: hasta 2 MB de memoria flash de programa con ECC: FlexNVM de 64 KB para memoria flash de datos con emulación ECC y EEPROM. Nota: Las escrituras/borrados CSEc (Seguridad) o EEPROM activarán indicadores de error en modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrado CSEc (Seguridad) o EEPROM. – SRAM de hasta 256 KB con ECC – Hasta 4 KB de FlexRAM para usar como emulación SRAM o EEPROM – Hasta 4 KB de caché de código para minimizar el impacto en el rendimiento de las latencias de acceso a la memoria – QuadSPI con soporte HyperBus™ • Analógico de señal mixta: hasta dos convertidores de analógico a digital (ADC) de 12 bits con hasta 32 entradas analógicas de canal por módulo – Un comparador analógico (CMP) con convertidor digital a analógico (DAC) interno de 8 bits • Funcionalidad de depuración – Serial Wire JTAG Combinación de puerto de depuración (SWJ-DP): punto de seguimiento y rastreo de depuración (DWT) – macrocelda de seguimiento de instrumentación (ITM) – unidad de interfaz de puerto de prueba (TPIU) – unidad de parche y punto de interrupción de Flash (FPB) • Interfaz hombre-máquina (HMI): hasta 156 pines GPIO con funcionalidad de interrupción – Interrupción no enmascarable (NMI)
• Interfaces de comunicaciones: hasta tres módulos de receptor/transmisor asíncrono universal de baja potencia (LPUART/LIN) con soporte DMA y baja disponibilidad de energía: hasta tres módulos de interfaz periférica serie (LPSPI) de baja potencia con soporte DMA y baja disponibilidad de energía – Hasta dos módulos de circuito interintegrado de baja potencia (LPI2C) con soporte DMA y baja disponibilidad de energía – Hasta tres módulos FlexCAN (con soporte CAN-FD opcional) – Módulo FlexIO para emulación de protocolos de comunicación y periféricos (UART, I2C, SPI, I2S, LIN, PWM, etc). – Hasta un Ethernet de 10/100Mbps compatible con IEEE1588 y dos módulos de interfaz de audio síncrono (SAI). • Seguridad y protección: el motor de servicios criptográficos (CSEc) implementa un conjunto completo de funciones criptográficas como se describe en la especificación funcional SHE (Secure Hardware Extension). Nota: Las escrituras/borrados CSEc (Seguridad) o EEPROM activarán indicadores de error en modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrado CSEc (Seguridad) o EEPROM. – Número de identificación única (ID) de 128 bits – Código de corrección de errores (ECC) en memorias flash y SRAM – Unidad de protección de memoria del sistema (MPU del sistema) – Módulo de comprobación de redundancia cíclica (CRC) – Vigilante interno (WDOG) – Módulo de monitor de vigilancia externo (EWM) • Temporización y control: hasta ocho módulos FlexTimers (FTM) independientes de 16 bits, que ofrecen hasta 64 canales estándar (IC/OC/PWM) – Un temporizador de baja potencia (LPTMR) de 16 bits con control de reactivación flexible – Dos bloques de retardo programables (PDB) con Sistema de disparo: un temporizador de interrupción de baja potencia (LPIT) de 32 bits con 4 canales: contador en tiempo real (RTC) de 32 bits • Paquete: QFN de 32 pines, LQFP de 48 pines, LQFP de 64 pines, LQFP de 100 pines, MAPBGA de 100 pines, LQFP de 144 pines, LQFP de 176 pines • DMA de 16 canales con hasta 63 fuentes de solicitud utilizando DMAMUX
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